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基于Verilog HDL的数字化多道预处理算法研究

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摘要

在研制基于FPGA的数字化多道脉冲幅度分析器的过程中,使用Verilog硬件描述语言完成FPGA中对数字信号的处理,包括梯形脉冲成形、基线估计、寻峰等.详细描述了梯形滤波成形的实现方式,解决了实现过程中数据溢出以及误差累积的问题.最后给出测得的137Cs能谱.

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来源
《中国核学会2011年年会》|2011年|99-102|共4页
会议地点贵阳
作者
王珂; 李政; 魏义祥; 方飞;
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作者单位

中国核学会;

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会议组织
正文语种
原文格式 PDF
中图分类信号分析;
关键词
数字化多道; 梯形滤波; 预处理算法; 脉冲幅度分析器; 硬件描述语言;

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