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一种新型的可配置的无死区全数字鉴相器设计

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本文提出了一种新型的可配置的无死区全数字鏊相器的设计方法，通过内嵌SRAM存储配置数据,由配置数据根据不同的输入时钟频率控制鉴相器的鉴相灵敏度。通过采用超前滞后算法、产生三种操作状态，可以避免鉴相死区。全数字结构使其无条件稳定，具有良好的噪声敏感度、较低的功耗。该电路可以作为标准的数字单元库使用，还可以应用于现场可编程逻辑器件(FPGA)中，作为其时钟管理电路，使FPGA内部复杂的时钟系统化。

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来源
《中国宇航学会计算机应用专业委员会2011年度技术交流会》|2011年|80-85|共6页
会议地点广西北海
作者
王憨; 陈雷; 张彦龙; 李学武; 郭晨光;
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作者单位

中国宇航学会;

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会议组织
正文语种
原文格式 PDF
中图分类鉴相、鉴相器;
关键词
数字鉴相器; 延时锁定环; 时钟频率; 电路设计;

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