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格雷码计数器的优化设计

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阐述了使用格雷码在高速数字电路设计中的重要意义,并进行了格雷码计数器在应用中的低功耗分析。着重介绍了一种格雷码的计数器的优化设计,该设计利用了格雷码编码的特殊性质,通过一个辅助的D触发器配合n个计数触发器工作的方式,组成新型n位的格雷码计数器。最后,给出了该计数器核心部分的VHDL语言实现,可以进一步应用于FPGA设计和其它相关的分析工作。

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来源
《全国第六届核仪器及其应用学术会议》|2007年|22-24|共3页
会议地点广西桂林
作者
程晓磊; 范如玉; 李斌康;
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作者单位

中国核学会;

中国电子学会;

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会议组织
正文语种
原文格式 PDF
中图分类气体电离探测技术和仪器;
关键词
格雷码计数器; 高速数字电路; 低功耗分析; D触发器;

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