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一种基于ME算法的高速RS译码方案

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Reed-Solomon码在数字通信系统中有着广泛的应用,用于降低数据在传输过程中的误码率。本文对RS译码器中求解关键方程的ME算法的VLSI结构进行了深入分析,提出了ME算法的流水线及最小化VLSI结构,以满足数据处理速率不断提高的需求。并利用该算法实现结构设计了一种低资源占用率的、低成本、高速RS译码器。逻辑综合及仿真结果表明,基于Altera公司Cyclone系列FPGA的RS(255,239)译码器,工作时钟高达204MHz,可满足数据速率1.632Gbits/s的编译码要求。

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来源
《2007'信息与通信工程、电子科学与技术、计算机科学与技术、机械工程全国博士生学术论坛》|2007年|213-216|共4页
会议地点西安
作者
王卫民; 杜兴民; 毕笃彦;
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作者单位

国务院学位办;

教育部;

西安电子科技大学学报;

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会议组织
正文语种
原文格式 PDF
中图分类 TP393.03;
关键词
RS码; ME算法; 钱搜索算法; Forney算法;

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