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基于SPARTAN3E-FPGA的多重数字时钟源的拓扑

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提出了一种利用Xilinx-FPGA的内部资源DCM实现多重数字时钟源设计的有效方法。DCM亦称为数字时钟管理器，它作为一个IP核的嵌入式结构可在顶层电路中灵活的调用。有效利用这一资源即可实现数字时钟源的级链型树状拓扑，在很大程度上提升了数字系统的性能。通过在Xilinx-ISE环境下的仿真分析和在以实验对象XC3S100E芯片上获得最终硬件验证，证明其功能的正确性。

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来源
《全国第一届嵌入式技术联合学术会议》|2006年|368-371|共4页
会议地点乌鲁木齐
作者
钱伟康; 虞菁; 郭强;
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作者单位

中国振动工程学会;

中国自动化学会;

中国体视学会;

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会议组织
正文语种
原文格式 PDF
中图分类微处理机;
关键词
嵌入式设计; 数字时钟管理器; 时钟树; 数字系统; 现场可编程门阵列;

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