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80C186XL嵌入式系统中DRAM控制器的CPLD解决方案

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本文介绍了怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上,利用CPLD技术和80C186XL的时序特征设计一个低价格,功能完整的DRAM控制器的设计方法,并采用VHDL语言编程实现.

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来源
《第七届计算机工程与工艺学术年会》|2001年|234-238|共5页
会议地点太原
作者
黄深喜; 彭少春; 杨安平;
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作者单位

中国计算机学会;

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会议组织
正文语种
原文格式 PDF
中图分类总体设计、系统设计;
关键词
刷新控制单元(RCU); DRAM控制器; 状态机; CPLD; VHDL语言; 嵌入式计算机系统;

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