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张榜; 雷元武; 彭元喜;
中国计算机学会;
乘法器; 单指令流多数据流; 运算速度; 4Booth编码; 华莱士树压缩;
机译:通过32位顺序乘法器实现乘法器和累加器单元最佳延迟和面积的VHDL设计与实现
机译:通过32位顺序乘法器实现乘法器和累加器单元最佳延迟和面积的VHDL设计与实现。
机译:使用具有最小路径延迟的吠陀实数乘法器的32位复数浮点乘法器的FPGA实现
机译:在高性能并行定点十进制乘法器设计上。
机译:NULL约定浮点乘法器
机译:使用VHDL的带有进位超前加法器的32位乘法器和带有纹波加法器的32位乘法器的性能分析
机译:spIm(斯坦福流水线迭代乘法器):流水线64 X 64位迭代乘法器
机译:使用4位乘4位乘法器和级联加法器的快速n位乘n位乘法器
机译:高速乘法器,以小尺寸实现,可以用作处理器的乘法器引擎,并在具有规则性的单一结构中设计
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