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带有数据过滤机制的分离式预取部件的设计与实现

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针对DSP芯片面临的"存储墙"挑战,根据指令和数据的失效特点,基于YHFT-XDSP芯片设计实现了一款带有数据过滤机制的分离式预取部件.与传统的基于减小Cache失效率的预取优化策略不同,它旨在减小Cache失效开销,命中状态下从预取缓存取数,且取数流水线时钟开销大幅减少,能显著提升CPU访存性能.

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来源
《第十八届计算机工程与工艺年会暨第四届微处理器技术论坛》|2014年|140-145|共6页
会议地点贵阳
作者
刘平; 鲁建壮; 孙永节;
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作者单位

中国计算机学会;

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会议组织
正文语种
原文格式 PDF
中图分类 TP332:TP303.1;
关键词
微处理器; 分离式预取部件; 数据过滤机制; 优化设计;

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1. PLC指令预取部件 IPU 的设计与实现 [J] . 刘振山 ,胖美云 . 北京航空航天大学学报 . 1992,第003期
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