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高速流水线数组处理机EZ-AP的设计

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介绍了应用大规模集成电路构成的高速流水线数组处理机EZ-AP的研制背景，以及设计指标、指令系统、体系结构等设计特点。该机主频15MC，字长32位，峰值速度可达30MFLOPS，由MECL10900和MECL10800等系列组件构成。虽主要用于大型数组数据的“乘加”处理，但由于其设计特点，它具有较好的通用性。（本刊录）

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来源
《全国青年计算机工作者学术交流会》|1987年|F328-331|共4页
会议地点哈尔滨
作者
王德州;
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作者单位

中国计算机学会;

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会议组织
正文语种
原文格式 PDF
中图分类微型计算机;
关键词
处理机; 指令系统; 系统设计; 数组处理机;

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