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王得光; 杭子钧; 黄友; 文梅;
中国计算机学会;
卷积神经网络; 并行加速; 中央处理器; 现场可编程门阵列; 异构多核平台;
机译:利用SIMD / MIMD自定义加速器评估基于FPGA的异构多核平台
机译:大型多核和加速器平台上的高效异构执行:使用块三对角求解器的案例研究
机译:异构多核处理器的设计方法,具有并行化多核模拟器和基于公共寄存器文件指令集扩展架构的组合
机译:使用异构CPU-FPGA平台的基于OpenCL的Canny算法加速
机译:用于大规模机器学习的异构CPU-FPGA平台上高效且可伸缩的平行随机梯度下降
机译:用于加速对照对传感系统并行/多核平台的非线性常微分方程的贡献
机译:CPU-FPGA共享存储器系统卷积神经网络的频域加速度
机译:减少异构多核平台上基于DaG的任务系统的响应时间限制。
机译:在多核处理器上使用并行堆以加速基于优先级队列的应用程序的并行优先级队列
机译:并行优先级队列利用多核处理器上的并行堆来加速基于优先级队列的应用程序
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