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首页> 外文会议>2013 8th International Workshop on Reconfigurable and Communication-Centric Systems-on-Chip >An FPGA design and implementation framework combined with commercial VLSI CADs
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An FPGA design and implementation framework combined with commercial VLSI CADs

机译：结合商用VLSI CAD的FPGA设计和实现框架

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Conventional full-custom reconfigurable logic device design and implementation are time consuming processes. In this research, we propose a design framework in order to improve FPGA IP core design efficiency by link academic FPGA design flow and commercial VLSI CADs based on the synthesizable method. A novel FPGA routing tool is developed in this framework, namely the EasyRouter. By using simple templates, EasyRouter can automatically generate the HDL codes and the configuration bitstream for an FPGA. With this design flow, accurate physical information can be reported when a new FPGA architecture is evaluated with reliable commercial VLSI CADs. For FPGA architectures that cannot be easily implemented with present VLSI process, EasyRouter provides a fast performance analysis flow, which improved delay accuracy 5.1 times than VPR on average.
机译：常规的全定制可重配置逻辑设备的设计和实现是耗时的过程。在这项研究中，我们提出了一个设计框架，以通过基于可综合方法将学术FPGA设计流程和商用VLSI CAD链接起来，从而提高FPGA IP内核设计效率。在此框架中开发了一种新颖的FPGA路由工具，即EasyRouter。通过使用简单的模板，EasyRouter可以自动生成FPGA的HDL代码和配置位流。通过这种设计流程，当使用可靠的商用VLSI CAD评估新的FPGA架构时，可以报告准确的物理信息。对于无法通过当前VLSI流程轻松实现的FPGA架构，EasyRouter提供了快速的性能分析流程，其延迟精度比VPR平均提高了5.1倍。

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