Great Wall Lab. of Modern Communication Institute, Shanghai Jiaotong University, Huashan Road 1954 Shanghai., 200030, P.R. China;
reed-solomon code; VHDL; algorithm; FPGA;
机译:使用VHDL技术的图像压缩算法
机译:一个使用VHDL构建和自动执行元胞自动机算法的CAD系统
机译:使用并行DiscreteEvent模拟算法执行VHDL模型
机译:VHDL算法(255,223)RS编码器
机译:用于Reed-Solomon编码器和解码器的VHDL代码生成器。
机译:基于PWL功能的多涡旋混沌振荡器的FPGA实现的VHDL描述
机译:使用VHDL的基于FPGA的BASK和BPSK调制器:不同调制器算法的设计,应用和性能比较
机译:具有交织器的VLsI单芯片(255,223)Reed-solomon编码器