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Logic Synthesis Techniques For Reduced Area Implementation Of Multilevel Circuits With Concurrent Error Detection

机译：具有并发错误检测功能的多电平电路小面积实现的逻辑综合技术

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来源
《》|2001年|P.651-654|共4页
会议地点
作者
Touba; N.A.; McCluskey; E.J.;
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正文语种
中图分类无线电电子学、电信技术;
关键词

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