A programmable low dropout regulator for delay correction network in DPWM

机译：DPWM中的可编程低压丢失调节器，用于延迟校正网络

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This paper presents a programmable low dropout regulator (LDO) with high PSRR. A programmable reference voltage required for LDO regulator has been implemented using a 5-bit digital to analog converter made of capacitive voltage divider network. The LDO regulator's PSRR performance is enhanced using a feed forward circuit. The output voltage of proposed LDO regulator has 32 discrete voltage levels in the range 1–1.2 V for load current in the range 100 μA to 5 mA. The PSRR of the proposed circuit is 89dB. The LDO regulator was designed in UMC 180nm technology. The proposed LDO regulator works with a supply voltage of 1.6 V and has a quiescent current of 23 μA. It can be used for delay matching in DPWM by changing supply voltage of delay elements.

机译：本文介绍了具有高PSRR的可编程低压丢弃调节器（LDO）。 LDO调节器所需的可编程参考电压已经使用5位数字到电容分压器网络制成的5位数字到模拟转换器来实现。使用馈电前电路增强了LDO调节器的PSRR性能。所提出的LDO稳压器的输出电压在1-1.2V范围内具有32个离散电压电平，对于100μA至5mA的负载电流。所提出的电路的PSRR为89dB。 LDO调节器是在UMC 180NM技术的设计中。所提出的LDO调节器的供应电压为1.6 V，静态电流为23μA。它可以通过改变延迟元件的电源电压来用于DPWM中的延迟匹配。

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来源
《nternational Conference on Reliability, Infocom Technologies and Optimization》|2015年||共6页
会议地点
作者
Harshil Jada; Gupta Anil Kumar;
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作者单位

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会议组织
原文格式 PDF
正文语种
中图分类计算技术、计算机技术;
关键词
Delays; Feeds; Mathematical model; Power supplies; Regulators; Transistors; Voltage control; digital pulse width modulation (DPWM); digital-to-analog converter (DAC); low-dropout regulator (LDO); power supply ripple rejection (PSRR);

机译：延迟;饲料;数学模型;电源;稳压器;晶体管;电压控制;数字脉冲宽度调制（DPWM）;数字到模拟转换器（DAC）;低压丢失调节器（LDO）;电源纹波抑制（PSRR）;

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