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首页> 外文会议>IEEE International System-on-Chip Conference >Variable-length VLIW encoding for code size reduction in embedded processors
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Variable-length VLIW encoding for code size reduction in embedded processors

机译：用于嵌入式处理器的代码大小的可变长度VLIW编码

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Very-long-instruction-word (VLIW) architectures are widely adopted in high-performance and low-power digital signal processors (DSP) due to their simplicity from extensive software optimizations. However, their poor code density (usually > 2× code size for a given application) and corresponding instruction accesses can overwhelm the energy savings on DSP datapaths. This paper presents variable-length VLIW (VL2IW), where the unused condition codes, operands/operand scope, and reduced range of immediate variables of TI C64x+ DSP are exploited to improve the code density. The static grouping and run-time dispersal schemes of the variable-length instructions in a VLIW packet are described. In our experiments, 21% code sizes are saved in average for MiBench kernels. The hardware overhead is only ~5%.
机译：由于他们的简单性来自广泛的软件优化，非常长的指令 - 词（VLIW）架构被广泛采用高性能和低功耗数字信号处理器（DSP）。然而，它们的代码密度差（通常>给定应用程序的2×代码大小）和相应的指令访问可以压倒DSP数据路径的节能。本文介绍了可变长度的VLIW（VL2IW），其中未使用的条件代码，操作数/操作数范围以及TI C64X + DSP的直接变量的减少范围，以提高代码密度。描述了VLIW分组中的可变长度指令的静态分组和运行时间分散方案。在我们的实验中，21％的码大小平均保存Mibench核。硬件开销只有〜5％。

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