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首页> 外文会议>IEEE Asia Pacific Conference on Circuits and Systems >Efficient successive cancellation decoder for polar codes based on frozen bits
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Efficient successive cancellation decoder for polar codes based on frozen bits

机译：基于冻结位的极性码高效连续消除解码器

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Recently, polar codes have received much attention due to their simple structure and low decoding complexity. However, because of the long decoding latency, polar codes are still not suitable for real-time applications. In this paper, by the analysis of the position of frozen bits and the architecture of conventional SC decoder, we present an efficient SC decoder architecture. Using the proposed architecture, the decoding latency of a polar code with length N can be reduced from N-1 to N/2-1. Also, the proposed architecture can reduce the number of MPEs about 33% compared with conventional SC decoder.
机译：近来，极性码由于其简单的结构和低的解码复杂度而受到了广泛的关注。然而，由于长的解码等待时间，极地码仍然不适合实时应用。在本文中，通过分析冻结位的位置和常规SC解码器的体系结构，我们提出了一种有效的SC解码器体系结构。使用所提出的架构，长度为N的极性码的解码等待时间可以从N-1减少到N / 2-1。而且，与传统的SC解码器相比，所提出的架构可以将MPE的数量减少约33％。

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