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多位量化Sigma-Delta模数转换器的设计

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第1章 绪 论

1.1课题背景

1.2国内外研究现状

1.3本课题的目的及意义

1.4课题的主要工作

第2章 Sigma-Delta ADC工作原理

2.1引言

2.2 Sigma-Delta调制技术原理

2.3过采样原理与噪声整形技术

2.4多位量化

2.5反馈DAC非线性

2.6动态单元匹配技术(Dynamic Element Matching)

2.7数字抽取滤波器原理

2.8本章小结

第3章 Sigma-Delta ADC的系统级设计

3.1引言

3.2 Sigma-Delta 调制器的设计指标

3.3 Sigma-Delta调制器的系统级设计

3.4系统级建模与仿真

3.5动态单元匹配算法抑制非线性

3.6本章小结

第4章 Sigma-Delta调制器电路实现

4.1引言

4.2开关电容积分器的设计

4.3多位量化器的设计

4.4 DWA实现及验证

4.5本章小结

第5章 数字抽取滤波器的设计

5.1引言

5.2级联积分梳状(CIC)滤波器

5.3补偿滤波器

5.4半带滤波器

5.5数字抽取滤波器仿真结果

5.6本章小结

结论

参考文献

攻读硕士学位期间发表的论文

声明

致谢

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摘要

随着MEMS陀螺数字化,智能化的未来需求,对数字陀螺接口电路的研究成为了热门,特别是对于接口电路中模数转换器(ADC)和数模转换器(DAC)的研究设计。本论文介绍了多位量化Sigma-Delta ADC的结构和性能参数,然后介绍了Sigma-Delta调制器的工作原理,并对比了一位量化和多位量化之间的优劣,根据设计指标确定了3阶3位量化全前馈结构 Sigma-Delta调制器。论文对Sigma-Delta调制器的非理想因素进行了Simulink模型的建立,并对非理想因素进行了分析。最后在晶体管级对Sigma-Delta调制器进行了仿真,并对仿真结果进行了分析。
  在Matlab中Simulink环境下首先对Sigma-Delta调制器进行了行为级的设计与仿真。理想情况下,10MHz采样频率,128倍过采样率,Sigma-Delta调制器系统信噪比为125.4dB,有效位数达到了20.53。之后考虑了调制器系统的非理想因素,主要对积分器建立误差、运算放大器有限增益、开关非线性、KT/C噪声和运算放大器噪声进行了分析与模型的建立。考虑到由于多位量化导致反馈DAC电容失配引入的非线性,采用了Mathwork提供的DataWeightedAveraging(DWA)行为级模型,对这种抑制非线性的算法进行了行为级的仿真,在考虑所有非理想因素以及1%电容失配的情况,系统谐波失真小于100dB,有效位数是16位,符合设计要求。
  电路设计的时候需要重点考虑第一级积分器运算放大器的设计,以及第一级引入的噪声。采用4输入比较器组成的Flash多位量化器能够有效降低功耗。开关的设计需要重点关注开关电阻的大小以及电阻非线性的问题,避免由于开关非线性导致的系统谐波失真过大。最后整个调制器电路在CSMC0.5um工艺,在Cadence中,加入0.5%电容失配,对采用DWA算法的调制器进行了仿真,并对仿真结果进行了分析,结果显示在采用DWA算法,调制器噪底低于-120dB,系统信噪比达到了112dB,谐波失真小于-120dB。
  最后本论文还设计了128倍降采样数字抽取滤波器,通带纹波小于0.01dB,阻带衰减小于-70dB。

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