一种基于资源优化的DDC设计及实现

魏静

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一种基于资源优化的DDC设计及实现

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数字接收系统中,对输入的射频信号直接中频采样后进行数字下变频(Digital Down Converter,DDC),有效减少了硬件模拟设备的数量,提高了系统的可靠性和稳定性。针对高速数字下变频存在的采样率高、资源消耗高等难点,利用滤波器系数的对称性特点设计了一种在不降低处理速度的前提下,减少现场可编程门阵列(Field ProgrammableGate Array,FPGA)内部处理单元个数,实现功耗降低的有限冲击响应(Finite Impulse Response,FIR)滤波器,并在FPGA中得到了实现。实验结果表明,该方法性能优异,可大幅节省资源,具有较高的工程实用价值。

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来源
《电声技术》 |2023年第3期|119-121|共3页
作者
魏静;
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作者单位

中国电子科技集团公司第三十八所;

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原文格式 PDF
正文语种 chi
中图分类变频器、混频器;
关键词
数字下变频(DDC); 有限冲击响应(FIR)滤波器; 现场可编程门阵列(FPGA);

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