图像验证系统设计及FPGA实现

乔世杰; 胡运平; 高勇

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用于JPEG2000静止图像压缩编码FPGA实现的图像验证系统.整个系统平台是由一个并口CMOS电脑眼、两个FPGA芯片、UART接口以及外部缓存组成.为了对搭建的平台进行验证,将并口电脑眼采集的图像数据存储在外部SRAM中,然后通过UART接口传送到PC机中,并通过PC机端的串口接收程序把采集的图像显示出来.完成了图像采集模块和UART接口模块的verilog HDL模型描述,通过了仿真和逻辑综合,并下载到FPGA芯片中,编写了串口接收程序,成功地实现了系统的联机调试.

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来源
《电子器件》 |2006年第3期|825-828|共4页
作者
乔世杰; 胡运平; 高勇;
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作者单位

西安理工大学电子工程系,西安,710048;

西安理工大学电子工程系,西安,710048;

西安理工大学电子工程系,西安,710048;

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原文格式 PDF
正文语种 chi
中图分类计算技术、计算机技术;
关键词
图像验证系统; UART; VerilogHDL; FPGA;

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