一种全数字时钟数据恢复电路的设计与实现

江黎; 钟洪声

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一种全数字时钟数据恢复电路的设计与实现

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时钟数据恢复(CDR)电路是数据传输系统的重要组成部分.对于突发的数据传输,传统的锁相环法很难达到其快速同步的要求.对此,文中提出一种改进型超前滞后锁相环法的全数字时钟恢复算法,与同类电路比较,具有数据码率捕获范围宽、辅获时间短的优点.文中还介绍了用FPGA来完成该电路设计.理论分析、仿真和实际测试表明,对非归零码,该电路的码率捕获范围5-20 MHz,20 MHz码率时相位抖动容限为2 ns.

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来源
《通信技术》 |2008年第11期|1-3|共3页
作者
江黎; 钟洪声;
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作者单位

电子科技大学电子通信大楼704教研室,四川成都,610054;

电子科技大学电子通信大楼704教研室,四川成都,610054;

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正文语种 chi
中图分类同步;
关键词
时钟数据恢复; 数据传输; 数字锁相; 同步;

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