CAN总线位定时和同步机制的设计与实现

王瑞晓; 贺占庄

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在CAN总线中,位定时和同步机制保证了CAN网络的正常通讯,是CAN控制器设计的难点和重点之一.鉴于此,在深入研究CAN总线位定时和同步机制工作原理的基础上,提出了一种位定时和同步机制的设计方法,并给出了相应的结构框图,对各模块进行详细介绍.该设计用verilog HDL代码实现,在Quartus Ⅱ 7.0环境中进行功能仿真.经分析,完全符合CAN2.0的协议规范,实现了位定时和同步的功能,从而验证了设计的正确性.

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来源
《计算机技术与发展》 |2010年第4期|235-238|共4页
作者
王瑞晓; 贺占庄;
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作者单位

西安微电子技术研究所;

陕西;

西安;

710065;

西安微电子技术研究所;

陕西;

西安;

710065;

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原文格式 PDF
正文语种 chi
中图分类计算机控制、计算机控制系统;
关键词
CAN总线; 位定时; 同步; Quartus Ⅱ 7.0;

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