高速VITERBI译码器的研究与设计

李庆; 李选中; 江汉红; 何文浩

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设计了一个高速(2,1,6)Viterbi译码器,通过采用并行基-4结构和比特级进位保存算法(Carry-Save Arith-metic),改进了Viterbi算法中加-比-选单元(Add-Compare-Select Unit)的结构,消除传统行波进位加法(Ripple-CarryAdder)结构中的进位链,缩减了Viterbi译码器的关键路径,从而提高译码速度,可用在中、高速数字通信的不同应用场合中.

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来源
《微电子学与计算机》 |2009年第1期|109-112|共5页
作者
李庆; 李选中; 江汉红; 何文浩;
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作者单位

武汉理工大学信息工程学院;

湖北武汉430070;

海军工程大学电气工程系;

湖北武汉430033;

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原文格式 PDF
正文语种 chi
中图分类逻辑设计;
关键词
Viterbi译码器; 进位保存算法; 加-比-选; 高速;

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