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基于ARM的嵌入式站间自动闭塞控制器硬件设计

         

摘要

针对铁路信号的高可靠性要求,设计了嵌入式站间自动闭塞系统的体系结构、嵌入式闭塞控制器和控制锁.详细设计了具有冗余特性的控制器硬件、比较电路和安全锁.同时,对本控制器构成的自动站间闭塞系统进行Petri网建模及分析.

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