一种新型的高速时钟数据恢复电路的设计和验证

叶国敬; 孙曼; 郭淦; 洪志良

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针对高速(Gbit/s)串行数据通信应用,提出了一种混合结构的高速时钟数据恢复电路。该电路结构结合鉴频器和半速率二进制鉴相器,实现了频率锁定环路和相位恢复环路的同时工作。和传统的双环路结构相比,在功耗和面积可比拟的前提下,该结构系统的复杂度低、响应速度快。电路采用1.8 V,0.18μm CMOS工艺流片验证,测试结果显示在2 Gbit/s伪随机数序列输入情况下,电路能正确恢复出时钟和数据。芯片面积约0.5 mm^2,时钟数据恢复部分功耗为53.6 mW,输出驱动电路功耗约64.5 mW,恢复出的时钟抖动峰峰值为45 ps,均方根抖动为9.636 ps。

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来源
《固体电子学研究与进展》 |2007年第4期|529-534|共6页
作者
叶国敬; 孙曼; 郭淦; 洪志良;
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作者单位

复旦大学专用集成电路与系统国家重点实验室;

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原文格式 PDF
正文语种 chi
中图分类设计;半导体混合集成电路;
关键词
模拟集成电路; 时钟数据恢复; 鉴频器; 半速; 非归零码;

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