面向视频处理的粗粒度可重构单元设计

赵启林; 李冰; 时美强; 熊军

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面向视频处理的粗粒度可重构单元设计

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针对视频处理算法,设计了一种面向视频处理的粗粒度可重构处理单元.它可以执行8位数据的加法、减法、乘法、乘加和求两数差的绝对值等操作,可以有效地支持高计算密度的视频处理算法.可重构处理单元使用Verilog设计,采用CMOS0.18μm工艺DC综合,面积为97913μm,关键路径为4.51ns,总的动态功耗为4.2mW.完成一次8×8像素块的2D-DCT算法和全搜索块匹配MAD算法分别需要10和15个时钟周期.

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来源
《微电子学与计算机》 |2010年第5期|82-86|共5页
作者
赵启林; 李冰; 时美强; 熊军;
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作者单位

东南大学集成电路学院;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
可重构处理单元; 视频压缩编码; 并行计算;

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