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并行哈夫曼编码器的硬件设计与实现

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摘要

文章设计了一种并行编码的哈夫曼硬件编码器,它采用了流水线和并行编码方法,使得在一个时钟周期内可以编码一个字节的数据,在编码时显著降低了工作频率。文章给出了关键部分的实现方案并分析了实验结果。

著录项

来源
《微电子学与计算机》 |2002年第10期|66-68|共3页
作者
倪泽峰; 王振华; 谭毅华; 田金文; 柳健;
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作者单位

华中科技大学图像信息处理与智能控制教育部重点实验室;

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原文格式 PDF
正文语种 chi
中图分类编码器;
关键词
编码器; 硬件设计; 哈夫曼编码; 数据压缩; 并行编码; Huffman编码;

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