可兼容AES-128、AES-192、AES-256串行AES加密解密电路设计

韩少男; 李晓江

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可兼容AES-128、AES-192、AES-256串行AES加密解密电路设计

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通过分析AES算法的基本原理,对算法中的AES-128、AES-192、AES-256三种不同的加密解密模式进行了综合设计,有效地利用了公共模块,与单个分别实施各个加密解密模式相比,大大减少了硬件电路面积.针对目前AES实现方法中的key产生模块进行了理论分析,提出了一种新的实现电路结构.设计出的串行AES硬件加密解密电路经综合后得到的芯片面积为31286门,最高工作频率为66MHz,可以满足目前的大部分无线传感网络的数据交换速率的需求.

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来源
《微电子学与计算机》 |2010年第11期|40-45|共7页
作者
韩少男; 李晓江;
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作者单位

中国科学院微电子研究所;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
AES算法; AES-128; AES-192; AES-256; 加密解密; ASIC;

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