应用于10Gbase-KR的二阶时钟数据恢复电路的建模分析与电路设计

栾文焕; 王登杰; 贾晨; 王自强

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应用于10Gbase-KR的二阶时钟数据恢复电路的建模分析与电路设计

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本文针对10 Gbase-KR的应用场合,设计了一款基于相位插值器的二阶CDR,通过对其进行线性建模分析,折中抖动容忍、锁定时间以及抖动峰值的关系,选取合适的增益系数,并采用SMIC 40 nm CMOS工艺完成了电路设计.其中二阶滤波器的比例和积分系数可调,可以追踪1000 ppm的偏差,恢复时钟的抖动最差情况为24 ps.

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来源
《微电子学与计算机》 |2020年第3期|1-4|共4页
作者
栾文焕; 王登杰; 贾晨; 王自强;
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作者单位

清华大学微电子学研究所;

北京100084;

深圳清华大学研究院;

深圳518057;

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原文格式 PDF
正文语种 chi
中图分类专用集成电路;
关键词
高速串行; 接收机; 时钟数据恢复; 二阶滤波器;

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