一种新型高速低成本可重构FFT处理器结构

潘伟; 刘欢; 李广军

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一种新型高速低成本可重构FFT处理器结构

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文中提出了一种基于FPGA的高速可重构FFT处理器结构.该结构采用精简控制算法[1]可针对从32点到1024点等不同点数数字信号进行FFT处理,并且在Xilinx公司Virtex2p系列FPGA上进行了综合及后仿真.结果表明该可重构结构相比Xilinx IP core而言资源占用减少16%~21%（slice）,最高时钟频率提高了10%~30%,输入输出延时减少了56~116个时钟周期,运算效率明显提高,而功耗相当.可适用于低成本高速数字信号处理系统.

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来源
《微电子学与计算机》 |2008年第11期|29-32|共4页
作者
潘伟; 刘欢; 李广军;
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作者单位

电子科技大学通信与信息工程学院;

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原文格式 PDF
正文语种 chi
中图分类设计与性能分析;
关键词
可重构; FFT; FPGA;

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