4GS/s-12bit ADC内置数字下变频器(DDC)的ASIC实现

薛金鑫; 马崇鹤; 周磊; 吴旦昱; 武锦

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4GS/s-12bit ADC内置数字下变频器(DDC)的ASIC实现

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本文提出了一种适合ASIC实现的可编程的数字下变频器(DDC)设计方法,该DDC嵌入于4GS/s-12bit ADC中,能够处理频率为4GHz的输入信号,并提供抽取因子分别为4、8、16、32的降采样功能.设计的DDC由一个基于CORDIC算法实现的数控振荡器(NCO)和一个全半带滤波器(HB-FIR)级联结构的抽取滤波器组组成.优化半带滤波器系数和各级数据精度,提出多种改进结构优化设计,有效减少硬件开销.基于40nm CMOS工艺,完成数字下变频器的前端设计和后端实现,并进行了流片.仿真结果显示,该设计可以在500 MHz的工作时钟频率下达到设计目标,抽取因子为4模式下,最大无衰减通带带宽可达420MHz,版图面积1550*650μm2,0.9V工作电压,功耗为180.69mW.验证了该设计方法适合于高速高精度数字信号的2n下变频.

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来源
《微电子学与计算机》 |2019年第1期|85-89|共5页
作者
薛金鑫; 马崇鹤; 周磊; 吴旦昱; 武锦;
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作者单位

中国科学院微电子研究所;

中国科学院大学;

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原文格式 PDF
正文语种 chi
中图分类通信理论;专用集成电路;
关键词
数字下变频器; 数控振荡器; 40nm; ASIC;

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