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基于Cadence异步时序电路分析与仿真

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摘要

探讨了在信号完整性分析中的异步时序电路的时序图及时序关系式,并结合具体的设计实例,计算出满足关系式的时序区间.最后在Cadence下进行了信号完整性仿真,验证了设计的时序匹配性,为高速PCB异步时序电路设计提供了一种分析与设计方法.

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来源
《机电产品开发与创新》 |2008年第6期|144-145,176|共3页
作者
乔正盛; 李建武;
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作者单位

华中光电技术研究所,湖北,武汉,430074;

华中光电技术研究所,湖北,武汉,430074;

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正文语种 chi
中图分类基本电子电路;
关键词
异步时序; 建立时间; 保持时间; 仿真;

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