采用FPGA实现合并单元同步采样的方案

晏玲; 李伟; 曹津平

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为了提高数字化变电站模拟量采集的同步精度,提出一种利用现场可编程门阵列(FPGA)实现合并单元(MU)同步采样的方案.通过分析同步误差产生的原因,指出MU内部晶振误差是造成同步性能不确定的主要原因.根据MU同步采样的要求,将秒脉冲(PPS)接收和处理的过程分为2个功能模块:PPS的接收和等间隔采样,通过准确捕捉PPS脉冲沿和精确划分采样间隔来提高同步采样精度,并利用FPGA芯片的特点,对每个步骤分别进行补偿和处理,将其误差控制在一定的范围内.实验证明该方案能使MU同步精度达到1μs.

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来源
《电力自动化设备》 |2010年第10期|126-128|共3页
作者
晏玲; 李伟; 曹津平;
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作者单位

富阳市供电局,浙江,富阳,311400;

华北电网有限公司,北京,100053;

北京四方继保自动化股份有限公司,北京,100085;

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原文格式 PDF
正文语种 chi
中图分类遥远测量与遥远控制;
关键词
合并单元; 现场可编程门阵列; 秒脉冲; 同步; 短期稳定度;

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