基于FPGA的万兆以太网TCP/IP协议处理架构

吴惑; 刘一清

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基于FPGA的万兆以太网TCP/IP协议处理架构

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cqvip:针对如今万兆网络流量服务器处理的瓶颈问题,提出了一种基于FPGA的万兆以太网TCP/IP协议处理架构。通过在处理架构中划分控制平面和数据平面,使各个逻辑电路模块的协同操作,并结合高速的I/O处理和存储器处理,利用硬件实现了完整的TCP/IP协议栈,有效的解决了服务器处理万兆网络流量的瓶颈问题。将所提出的架构应用于实际万兆以太网TCP/IP卸载板卡中,其协议支持ARP、ICMP、UDP、TCP等,并且时延最低可达0.288μs,文件传输速率可达933 MB/s,CPU资源占用率仅为10%,光口有效数据吞吐率可达9.034 Gbps。

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来源
《电子设计工程》 |2020年第9期|81-87|共7页
作者
吴惑; 刘一清;
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作者单位

华东师范大学通信与电子工程学院上海200241;

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原文格式 PDF
正文语种 chi
中图分类 TN393.1;
关键词
万兆以太网; FPGA; TCP/IP协议栈; TOE;

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