基于FPGA的二取二总线数据比较器

刚建雷; 韩安平; 胡燕来

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基于FPGA的二取二总线数据比较器

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@@%基于FPGA的二取二总线数据比较器实现联锁逻辑运算的两块CPU板总线数据的实时校核.在两条总线数据比较一致且总线数据的CRC校核通过时两个FPGA分别输出互为反相的动态脉冲,板上驱动电路输出信号控制板外供电继电器对联锁系统驱动单元供电,否则通过停止输出动态脉冲在50ms内切断供电继电器.出现校核错时FPGA将比较不一致的两个数据及在对应数据包中的位置等信息反馈给对应CPU板,便于故障分析.通过监测回读信号实现板上驱动电路的实时检测,在驱动电路出现硬件故障时可导向安全.该比较器遵循EN50128,EN50129和EN50126标准流程开发,已通过欧标SIL4级安全认证.

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来源
《电子产品世界》 |2012年第6期|56-58|共3页
作者
刚建雷; 韩安平; 胡燕来;
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作者单位

中国铁道科学研究院通信信号研究所北京100081;

中国铁道科学研究院通信信号研究所北京100081;

中国铁道科学研究院通信信号研究所北京100081;

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原文格式 PDF
正文语种 chi
中图分类
关键词
二取二; 总线比较器; 故障-安全; 安全动态电路;

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