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一种高速I2C总线从器件接口IP核的设计与实现

         

摘要

本文介绍了I2C总线的工作过程,使用图形化设计工具,采用HDLVeriog高级硬件描述语言按照自顶向下的设计方法完成了I2C从器件模式的IP核设计。通过特殊的设计思路,可实现高速数据传输。对此IP核用FPGA 进行了验证,最终把它作为一个独立IP成功的应用于ASIC芯片设计中。

著录项

  • 来源
    《电子产品世界》 |2011年第7期|57-59|共3页
  • 作者

    刘宇; 张斌; 张云军;

  • 作者单位

    西安邮电学院深亚电子有限公司,陕西西安710061;

    西安邮电学院深亚电子有限公司,陕西西安710061;

    西安邮电学院深亚电子有限公司,陕西西安710061;

  • 原文格式 PDF
  • 正文语种 chi
  • 中图分类
  • 关键词

    I2C总线;

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