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LDPC码译码器通用模块的FPGA设计

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摘要

在介绍LDPC（Low Density Parity Code）低密度校验码的基本迭代译码原理的基础上,针对FPGA技术,专门设计了译码器中通用的变量节点以及校验节点处理单元,其中分别包括全并行与全串行的实现方式。编译结果表明,这些模块可以实现高速的处理速度,以及占用合理的硬件资源。

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来源
《电子技术与软件工程》 |2016年第14期|P.117-118|共2页
作者
裴培;
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作者单位

中国电子科技集团公司第五十四研究所,河北省石家庄市050000;

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原文格式 PDF
正文语种 CHI
中图分类 TP311.13;
关键词
低密度校验码 FPGA 串行并行;

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