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董宜平; 谢达; 宋林峰; 周道逵;
中国电子科技集团公司第五十八研究所,江苏无锡214072;
内建自测试; 时钟树;
机译:90纳米FPGA I / O缓冲器设计,源同步系统的数据速率为1.6 Gb / s,外部存储器接口的时钟速率为300 MHz
机译:时钟发生器,缓冲器和PCle时钟IG /缓冲器
机译:负载平衡时钟树综合与可调延迟缓冲器插入,可减少多种动态电源电压设计中的时钟偏斜
机译:Xilinx FPGA中片上电路间通信的时钟缓冲器的特性
机译:功率和定时驱动最佳栅极,时钟缓冲器和时钟线寸在高性能数字集成电路中尺寸
机译:无线传感器网络中具有缓冲器/通道感知的联合时延功率折衷分析及其FPGA实现
机译:基于RRAM的FPGA路由结构缓冲器分布研究
机译:在基于sRam的FpGa TmR设计中实现冗余与奇异时钟域的易感性。
机译:FPGA上全局全局本地同步(GAL)电路的时钟方案
机译:用于全局时钟缓冲器的半导体器件测试仪的信号生成设备的格式,以最小化现场可编程门阵列中时钟信号的偏斜
机译:可调谐的扇区缓冲器,可实现宽带谐振全局时钟分配
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