一种应用于多通道模数转换器的串行输出接口设计

穆敏宏; 叶凡; 任俊彦

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一种应用于多通道模数转换器的串行输出接口设计

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本文设计了一款适用于高速多通道模数转换器的串行输出接口,包括扰码、并串转换、DLL与CML等模块,实现了3∶1并转串输出.相比于传统串行扰码发生器的结构,本文提出了一种新的并行扰码发生器设计方法,能缩短关键路径的延时.同时,文中还对串行输出接口进行了设计优化,降低了温度、电压波动带来的影响,面积、功耗等性能均有提升.串行输出接口采用65nm CMOS工艺设计,数字模块电路(扰码发生器、并串转换电路、DLL)的版图面积为72μm×97μm,CML输出电路的版图面积为85μm×53μm.版图后仿真显示单通道总功耗11.5mW,在不同输入相位下均能实现并行1.33Gb/s×3bits到串行4Gb/s×1bit的并串转换,满足模数转换器对输出接口的要求.

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来源
《复旦学报：自然科学版》 |2018年第5期|596-604|共9页
作者
穆敏宏; 叶凡; 任俊彦;
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作者单位

复旦大学专用集成电路与系统国家重点实验室;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
多通道模数转换器; 串行输出接口; 延迟锁定环; 电流模逻辑;

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