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祝瑞元; 顾纯晨; 赵裔; 方昊; 洪志良;
复旦大学专用集成电路与系统国家重点实验室;
时钟交叠ADC; 后台校准技术; 失调失配; 增益失配; 时间偏差;
机译:具有级联校准的折叠-插值架构的后台自校准6b 2.7 GS / s ADC
机译:具有带背景通道不匹配校准的40nm CMOS 7-B 32-GS / S SAR ADC
机译:具有模拟HPF辅助偏斜校准和随机采样参考ADC的12b 1-GS / s 31.5mW时间交错SAR ADC
机译:多通道相干接收机中65GS / s ADC的时钟同步复位和偏移校准
机译:具有快速FPGA仿真功能的SAR ADC的后台数字校准。
机译:采用双重片内校准和精度增强技术的1.15μW200 kS / s 10-b单调SAR ADC
机译:极化和干涉saR校准验证方法
机译:动态连续近似寄存器(SAR)模数转换器(ADC)(SAR-ADC)时钟延迟校准系统和方法
机译:SAR ADC时间交错流水线SAR ADC,可将通道偏移失配降至最低
机译:在ADC辅助时间数字转换器(TDC)中校准到逐次逼近寄存器(SAR)模数转换器(ADC)的输入信号的系统和方法
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