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非理想数字频率合成情况下的数字下变频器的设计

         

摘要

当数字下变频器中的频率合成存在杂散和噪声时,数字下变频器的输出信号容易发生频率混叠从而导致失真。本文拟通过改进数字下变频器的设计,消除该信号失真问题。本文首先建模分析频率合成过程中产生的杂散和噪声,然后根据杂散产生的原因提出3种数字下变频器的改进方法,分别为:(1)减少频率合成器相位舍位数;(2)选择优化数字下变频器采样速率;(3)添加带通滤波。同时,根据噪声产生的原因提出提高下变频器的采样速率的改进方法。最后,通过仿真验证了理论分析的正确性以及改进方法的有效性。

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