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来新泉; 李玉山; 高德远;
西安电子科技大学电路CAD所;
西北工业大学计算机科学与工程系;
设计; CMOS; 数模混合锁相环; 专用集成电路;
机译:适用于0.18μmCMOS工艺WiMAX应用的低功耗,低抖动PLL设计
机译:使用0.13-μμmCMOS技术的0.8–77.5-GHz超宽带分布式漏极混频器的设计和分析
机译:0.8 V 450μW2.4 GHz PLL,采用后栅极QVCO,适用于0.18μmCMOS的ZigBee / BLE标准
机译:基于0.18μMCMOS工艺的2GHz发射机设计及其线性化,以及基于0.25μM锗硅双极工艺的8 GHz收发器设计(采用GSML方法)。
机译:适用于AlN PMUT阵列的微型0.13μmCMOS前端模拟
机译:基于0.18μmCMOS技术的低锁定时间的数字PLL合成器的实现。
机译:具有两个独立相位检测器的pLL优化设计。
机译:时钟发生器具有带模拟控制振荡器的PLL电路,设计了第二个振荡器,因此振荡频率可通过数字逐步可变控制信号在规定范围内变化
机译:使用模拟锁相环(PLL)的设计阶段
机译:存储介质,用于在半导体设计过程中模拟的方法的说明,在半导体设计过程中执行模拟方法的半导体设计系统,以及在半导体设计过程中的模拟方法
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