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刘兰石; 郭建英; 王长清;
河南师范大学物理与信息工程学院;
濮阳职业技术学院;
河南师范大学物理与信息工程学院 河南新乡453002;
河南濮阳457000;
河南新乡453002;
异步串行通信; VHDL; EDA CPLD; FPGA状态机;
机译:基于VHDL的异步电路设计方法
机译:用于异步电路设计的串行本地时钟控制器的综合
机译:电路设计到VHDL设计:VHDL开发
机译:基于DSP和MAX3160的异步串行通信接口设计
机译:利用时间独立性进行VHDL数字电路描述的并行,分布式,异步,先发性事件驱动的仿真。
机译:集成MEMS-LSI传感器的48个单端I / O传感器平台LSI的异步串行总线通信网络的电气设计和评估
机译:一种基于高速串行通信数据传输网络通信接口模块的电路设计
机译:超高速集成电路(VHIsC)硬件描述语言(VHDL)交互验证炼金术(VIVa)。用于VHDL相关工具的半自动,高保真验证的技术和软件。
机译:使用两个多路复用器电路和控制逻辑的通信接口单元,用于执行所选异步协议的并行到串行数据转换
机译:自动售货机,即用于输入和/或输出票据的自动柜员机,具有被设计为无线通用串行总线接口的通信接口,该通信接口的一部分用于执行向计算机的数据传输
机译:在混合语言混合信号设计中连接verilog-AMS和VHDL-AMS组件
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