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基于VHDL的生产线定时计数系统设计

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摘要

定时计数系统在自动化生产线中有着广泛的用途。本文采用VHDL硬件描述语言,运用自顶向下的设计思想设计了生产线中定时计数系统。文中给出了系统硬件连接图、总体逻辑结构图并进行了逻辑仿真。结果表明,该定时计数系统设计功能正确,结构简单、控制精确。

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来源
《科技与创新》 |2010年第35期|12-14|共3页
作者
张俊梅; 李锦清; 刘芷宁; 石磊;
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作者单位

北京林业大学工学院;

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原文格式 PDF
正文语种 chi
中图分类存贮器;
关键词
定时计数; VHDL硬件描述语言; 逻辑仿真;

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