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季雄; 段吉海; 胡媛媛; 袁柯; 于海生;
广西桂林电子工业学院通信与信息工程系;
VerilogHDL; UART; 帧格式; 状态机;
机译:基于VHDL的UART串行通信模块设计与仿真
机译:使用HSTL I / O标准的基于28nm FPGA的功耗优化UART设计
机译:基于适应的UART基于UART配置和IC原型的读出界面
机译:在FPGA中使用BIST技术实现UART。
机译:基于高效的基于组合的计算蛋白设计及其应用于C-RAF-RBD的重新设计的新颖可提供的算法:KRAS蛋白蛋白界面
机译:基于电压缩放的高效UART设计及其在7系FPGA上的实现
机译:基于概率的木材传动结构设计 - 第2卷:基础分析和基于概率的木结构设计
机译:UART或类似并行UART接口的基于内存的缓冲
机译:uart内部的控制电路,用于单通道通信的uart和uart中的处理
机译:异步帧接收器(特别是用于微控制器中的UART型电路中)的设计允许更快地热连接到异步数据总线
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