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郭玉璞;
电子工业部东北微电子研究所;
CMOS; 集成电路; 总线驱动器; 工艺;
机译:具有54nm CMOS的低功耗和低噪声数据总线反转功能的高速图形DRAM
机译:CMOS 0.18μm600 MHz时钟乘法器PLL和伪LVDS驱动器,用于ALICE内部跟踪系统前端芯片的高速数据传输
机译:用于分段InP Mach-Zehnder调制器的高速BiCMOS线性驱动器内核
机译:使用测试板和高速CMOS驱动器进行共面总线模型验证
机译:使用标准CMOS技术进行光学数据传输的高速CMOS激光驱动器设计。
机译:通过改进的PSO减少DDR3高速总线上的反射
机译:延迟约束CmOs总线驱动器的功率优化
机译:多阈值互补金属氧化物半导体(mTCmOs)总线电路和通过脉冲待机开关降低总线功耗的方法。
机译:可编程CMOS总线和传输线驱动器(可编程CMOS总线和传输线驱动器)
机译:CMOS BTL兼容总线和传输线驱动器(CMOS BTL兼容总线和传输线驱动器)
机译:高速CMOS总线驱动器电路
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