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黄进燕;
中国电子科技集团公司第54研究所,石家庄,050081;
SDRAM 高速DSP CADENCE 信号完整性;
机译:带有Sdrams的基于Fpga的高速硬件仿真器的高效内存利用
机译:高速DDR3 SDRAM控制器的设计
机译:DDR-SDRAM,高速,源同步接口带来设计挑战
机译:基于PCI总线的高速数据采集中SDRAM控制器的设计。
机译:探索用于VLSI设计的CadenceRTM EDA工具。
机译:SPLASSH:开源软件用于基于相机的高速多光谱体内光学图像采集
机译:使用45nm技术在Cadence Virtuoso中使用不同乘法器的低功率高速16位算术单元的设计与实现
机译:基于高速相机和aRamIs摄影测量软件的动态冲击变形分析
机译:适用于RF CMOS和RF SIGE BICMOS应用的高容忍TCR平衡高电流电阻器,以及具有可调TCR和ESD电阻镇流特性的基于CADENCE的基于层次的分层参数化电池设计套件
机译:适用于RF CMOS和RF SiGe BiCMOS应用的高容忍TCR平衡高电流电阻器,以及具有可调TCR和ESD电阻镇流特性的基于CADENCE的层次化分层参数化电池设计套件
机译:将基于对象的设计软件与基于记录的CAD软件相集成
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