流水线处理器中Cache模块的设计

李红桥; 肖建青; 张洵颖; 龚龙庆

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流水线处理器中Cache模块的设计

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流水线结构能大幅提高指令执行速度,但是由于主存读取速度过慢,系统性能的提升仍然受到限制.现实现的Cache设计,是流水线与主存间的高速缓冲器,它能有效地解决访存的瓶颈问题,使流水线功能得到充分发挥.文章首先分析流水线的结构特点,确定Cache的结构功能,在此基础上提出一个组相联映射Cache的设计.分析Cache实现读写操作的具体控制过程,并给出LRU(least recently used)替换算法的实现.最后通过介绍猝发取指操作着重讨论了Cache与流水线间的配合机制.

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来源
《科学技术与工程》 |2010年第32期|8084-8089|共6页
作者
李红桥; 肖建青; 张洵颖; 龚龙庆;
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作者单位

西安微电子技术研究所,西安,710054;

西安微电子技术研究所,西安,710054;

西安微电子技术研究所,西安,710054;

西安微电子技术研究所,西安,710054;

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正文语种 chi
中图分类 TP393.06;
关键词
流水线; 组相联; LRU替换算法; 猝发取指;

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