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王晶; 陈少晖; 雷华军;
海南软件职业技术学院;
全加器; 逻辑表达式; 逻辑电路;
机译:使用GDI技术的区域延迟和节能1位全加器的设计与实现
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机译:亚阈值区域内ALU的1位FinFET全加器单元的设计与实现
机译:从一位老师到另一位老师:对“ Abacuc”中Bede尊贵人物的分析。
机译:量子点元胞自动机中高效全加器的设计
机译:基于单元和sOC技术的aLU亚微米级10T全加器的设计与实现
机译:常规结构中嵌入的一位全加器的优化
机译:跳过一位全加器和FPGA器件
机译:可跳过的一位全加器和FPGA器件
机译:具有等效输入的二进制编码器-具有带有单个一位全加器的级,将前两个级的结果相加
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