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孟秉林; 吴柯锐; 刘杏娟;
中北大学仪器科学与动态测试教育部重点实验室,山西太原030051;
空军驻山西地区军事代表室,山西太原030024;
DDS; 现场可编程门阵列(FPGA); 相位累加器; Verilog_ HDL;
机译:使用DDS基于DDS信号源的Fractional-N PLL中的虚假抑制方法
机译:分布式Verilog仿真的多路设计驱动分区算法
机译:基于FPGA和DDS的多通道信号源
机译:使用DDS合成器的相干信号源进行T / R通道分析的结果
机译:基于软件代理的环境框架,用于链接Verilog的分布式仿真。
机译:基于基于循环平稳性的FRESH滤波的基于快速卷积滤波器组的非正交多路复用认知无线电(NOMCR)接收器设计
机译:农村电网故障检测DDS电流信号源设计
机译:sDms(船载数据多路复用系统)DD 963信号列表DD 963类船舶信号由sDms多路复用,用于TECHEVaL / OpEVaL
机译:Spice到Verilog网表转换器以及使用Spice进行Verilog和Verilog进行Spice翻译的设计方法
机译:ODDS设计的下注方法,ODDS设计的下注程序和ODDS设计的下注设备
机译:具有直接可提取DDS信号源的信号发生器
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