一种高效RS编解码器的FPGA实现

李晓飞; 牟崧友

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提出了一种实现复杂度低、高效率的RS(204,188)编解码器的FPGA实现电路.整个FPGA设计分为RS编码器、Homer准则的伴随式计算、改进的BM算法、Chien搜索求根和Forney算法求差错幅值等5个模块,同时,总体电路采用了pipeline结构,有效提高了译码速率.选用Xilinx公司的Spartan3E系列XC3S500E芯片,译码时延242个时钟周期,使用FPGA资源186000门,译码性能与理论值一致,已用于特定无线图像传输系统.

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来源
《电视技术》 |2008年第12期|32-34,45|共4页
作者
李晓飞; 牟崧友;
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作者单位

南京邮电大学,通信与信息工程学院,江苏,南京,210003;

南京邮电大学,通信与信息工程学院,江苏,南京,210003;

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原文格式 PDF
正文语种 chi
中图分类编码器;
关键词
Reed-Solomon码; 现场可编程门阵列; 改进BM算法; Chien搜索; Fomey算法;

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